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As instruções em VHDL podem ser divididas em alguns tipos:
A sintaxe dos sinais concorrentes é a mais comum. O valor da expressão é transferido para o sinal alvo pelo operador “<=”. Pode-se descrever como:
Exemplos:
No código da Figura 2 vemos um exemplo que descreve uma porta NAND e uma OR utilizando atribuição de sinal concorrente.
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