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arrow_back Aula 05 - VHDL – Parte II

Estudando o CASE

A sintaxe da expressão é esta que vemos na Figura 11:

AخA
1
case (expressão) is
2
    when condição 01 =>
3
        {declaração 01}
4
    when condição 02 =>
5
        {declaração 02}
6
    when others =>
7
        {declaração 03}
8
end case;
Figura 11 - Exemplo de trecho de um código VHDL usando a estrutura CASE

No caso do CASE, todas as expressões são avaliadas e a que for satisfeita, a declaração relacionada a condição, será executada. O último when others (quando outros) não é obrigado estar na sintaxe da expressão. Perceba que o CASE também tem sua estrutura intrisicamente sequencial e, portanto, deve estar dentro de um process. Nada melhor do que um exemplo para analisarmos o funcionamento dessa expressão, não é?. Vamos analisar com a equação implementada para o CASE, out1=A¯BC+ABC+¯ABC:

Figura 12 - Exemplo de um código VHDL usando a estrutura CASE
Exemplo de um código VHDL usando a estrutura CASE
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